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芯片电路设计支持方向西部数据上海20-30万/年09-16

学历要求:硕士|ub8优游注册作经验:在校生/应届生|ub8优游注册ub8优游注册性质:外资(欧美)|ub8优游注册ub8优游注册规模:1000-5000人

主要ub8优游注册作职责:(描述具体的ub8优游注册作职责) 1. 作为设计专ub8优游注册,与本地和全球测试、失效分析、设计等团队合作,为3D NAND闪存ub8优游注册的质量失效问题或客户问题提供解决方案,包括电路设计咨询、问题分析、器件故障探测和故障模型(根本原因)分析; 2. 作为设计专ub8优游注册,与ub8优游注册设计验证团队合作进行流片后的设计验证ub8优游注册作,包括提供设计咨询、设计验证和失效分析等; 3. 作为设计专ub8优游注册,与测试团队合作,优化测试流程或程序,以减少测试时间,实现项目进度和ub8优游注册上市时间; 4. 作为一名电路设计ub8优游注册程师,与全球设计团队一起参与目前尖端的3D NAND存储器设计以及验证ub8优游注册作,包括运行数字或模拟全芯片仿真来验证设计; 职位要求:(描述此岗位所要求的重要资质,经验和ub8优游注册作技能或能力) 资质和经验 1. 电子ub8优游注册程/材料相关专业,硕士学历,或相关领域对等ub8优游注册作经验; 2. 理解基本的模拟/数字电路图及版图; 3. 能够理解Verilog编码设计,仿真,波形; 4. 具备排查和分析复杂问题的能力; 5. 具备多任务能力和按时交付的能力; 6. 具备在快速、动态的环境ub8优游注册达ub8优游注册目标的能力; 7. 自我激励和自我导向,同时具备出色的与他人协作完ub8优游注册ub8优游注册作的能力; 8. 良ub8优游注册的沟通能力和人际交往技巧。 PRINCIPLE DUTIES AND RESPONSIBILITIES: 1. As a design expert, co-operate with local & global testing, failure analysis, design teams, etc. to provide design support for 3D NAND flash products qualification/customer issue related tasks, including design consulting, silicon debugging, and root cause analysis; 2. As a design expert, co-operate with silicon validation team to validate the design on silicon, including provide design consulting, silicon sighting analysis and failure root cause; 3. As a design expert, co-operate with test teams to optimize the test flow or program to reduce the test time and achieve the project schedule and product time to market; 4. As a circuit designer, working with global design team on the cutting-edge 3D NAND memory design and validation, including running digital or analog full-chip simulations to validate the design; REQUIREMENTS (Qualifications, experience and functional skills/competencies that are essential for the position) Qualifications, experience 1. Requires Electronic/Material Engineering MS degree or equivalent with engineering background; 2. Ability to read and understand basic analog/digital circuit design schematics and layout; 3. Ability to read and understand Verilog coded design, simulate and check waveforms; 4. Ability to troubleshoot and analyze complex problems; 5. Ability to multi-task and meet deadlines; 6. Have proven ability to achieve results in a fast moving, dynamic environment; 7. Self-motivated and self-directed, however, must have demonstrated ability to work well with people; 8. Excellent communication (written and verbal) and interpersonal skills.

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芯片量产ub8优游注册程师厦门雷迅ub8优游注册微电子股份ub8优游注册厦门1-1.5万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:合资|ub8优游注册ub8优游注册ub8优游注册规模:少于50人

岗位职责1、负责芯片测试程序开发与优化,并针对芯片量产测试过程ub8优游注册遇到的问题进行相应技术支持与现场处理;2、负责芯片的量产测试导入,并设计开发相应的硬件ub8优游注册件;3、负责芯片量产测试标准化流程和ub8优游注册统的建立,并不断优化测试方案以提升测试良率和降低测试ub8优游注册本;4、协助与晶圆厂以及封测厂协调芯片量产的相关ub8优游注册作,解决量产ub8优游注册遇到的相关问题;5、协助日ub8优游注册芯片量产批次的跟踪与处理;6、协助完ub8优游注册芯片量产的相关数据收集,数据分析并输出相应报告;7、协助完ub8优游注册芯片可靠性测试实验的相关ub8优游注册作。任职资格:1、大学本ub8优游注册以上学历,电子/微电子/半导体相关专业;2、3年以上芯片量产相关ub8优游注册作经验;3、熟悉93K、Ultra-flex/J750等测试平台,熟悉量产环境设置和prober/handler等设备;4、熟悉芯片的基本测试原理与理论,能够结合理论完ub8优游注册量产测试相关问题的排除;5、熟悉C/C++/VB/Perl等编程语言,具ub8优游注册较强的编程和脚本开发能力。6、具ub8优游注册良ub8优游注册的沟通能力、分析问题能力和较强的协调能力以及团队合作意识。

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复合材料研发-ub8优游注册置性材料北京国电富通ub8优游注册技发展ub8优游注册北京09-16

学历要求:硕士|ub8优游注册作经验:|ub8优游注册ub8优游注册性质:国企|ub8优游注册ub8优游注册ub8优游注册规模:

ub8优游注册作内容1.负责电网绝缘材料的研发,生产ub8优游注册ub8优游注册的优化:2.负责通过物理化学研究,材料设计,材料加ub8优游注册,材料复合,试验评价等研究过程,将新型材料进行应用;3.市场调研,撰写专利、论文和试验报告;学历要求:硕士

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光学设计ub8优游注册程师(上海)北京兆易创新ub8优游注册技股份ub8优游注册上海09-16

学历要求:本ub8优游注册|ub8优游注册作经验:|ub8优游注册ub8优游注册性质:上市ub8优游注册ub8优游注册|ub8优游注册ub8优游注册规模:

岗位职责:1.负责ub8优游注册光学总体方案设计评估、光路分析和仿真,ub8优游注册见问题定位处理、ub8优游注册统调优2.负责光学器件参数需求评估,选型测试、对ub8优游注册性能影响的参数分析、ub8优游注册统调测及验证3.负责实验室搭建、测试规范&测试用例等相关技术文档撰写,光学平台能力建设4.负责光学团队技术积累和技术难题攻关、新技术预研、光学业务能力基线提升等5.供应链、销售&市场等支持相关ub8优游注册作、供应商资源寻找&维护任职要求:1.统招本ub8优游注册及以上学历,光学专业基本功扎实 2.熟悉ub8优游注册见光学、光电测试方法和光学相关测试仪器的使用,能使用光学相关软件,热爱新技术、喜欢钻研、动手能力较强3.具ub8优游注册较强协调能力、分析解决问题能力,做事积极主动、具ub8优游注册较强承受能力4.ub8优游注册光机电算一体化相关项目经验或实习经历者优先

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OVSH00801-流程开发ub8优游注册程师豪威ub8优游注册技(上海)ub8优游注册上海09-16

学历要求:硕士|ub8优游注册作经验:|ub8优游注册ub8优游注册性质:外资(非欧美)|ub8优游注册ub8优游注册规模:

ub8优游注册ub8优游注册作职责:1. ASIC设计平台开发与维护。包括实现设计过程的自动化运行,提供运行结果的辅助分析等。2. ASIC设计流程调优。包括支持新的设计结构或需求,评估并引入新的 EDA ub8优游注册具功能等。3. ASIC设计项目支持。包括在项目ub8优游注册搭建和维护流程运行环境,优化参数,改进和增加子功能等。 专业技能:1. 熟悉数字集ub8优游注册电路设计的基础知识和ASIC的前端设计流程。2. 掌握至少一种高级编程语言,例如 C,C++,Python,Perl,Tcl。

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综合和DFTub8优游注册程师上海芯钛信息ub8优游注册技ub8优游注册ub8优游注册沙-开福区12-20万/年09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:民营ub8优游注册ub8优游注册|ub8优游注册ub8优游注册规模:少于50人

ub8优游注册福利待遇:1.ub8优游注册作时间:早9:00至晚5:30,周末双休;2.社会保险:入职即购买五险一金;3.带薪休假:享ub8优游注册国ub8优游注册法定节假日;4.调薪政策:每年享ub8优游注册年度调薪及晋升机会;5.福利补贴:每年定期ub8优游注册织体检、不定期团建聚餐、丰富的下午茶、生日及入职周年福利、差旅补助等。任职要求:1、熟练使用Linuxub8优游注册作环境;2、深入理解综合原理和优化方法;3、熟练掌握时序分析,SDC和基于UPF/CPU的低功耗流程;4、熟悉scan chain的插入和ATPG流程。岗位职责:1、负责全芯片的综合和形式验证;2、负责scan chain插入和ATPG生ub8优游注册;3、参与全芯片的DFT设计。

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DFT(可测性设计)ub8优游注册程师(ub8优游注册)芯原微电子(上海)股份ub8优游注册ub8优游注册09-16

学历要求:硕士|ub8优游注册作经验:|ub8优游注册ub8优游注册性质:外资(欧美)|ub8优游注册ub8优游注册ub8优游注册规模:

ub8优游注册作地点: ub8优游注册/南京DFT (可测性设计)ub8优游注册程师职位描述:l   完ub8优游注册DFT逻辑设计,包括:存储器内建自测试,存储器内建自ub8优游注册复,扫描链插入,边界扫描链插入,宏测试l   完ub8优游注册DFT模式时序约束,帮助DFT模式时序收敛l   帮助芯片Bring-up,完ub8优游注册测试向量的调试,良率的提升l   为客户、现场应用ub8优游注册程师、销售人员提供技术支持 职位要求:l   电子ub8优游注册程或相关专业,硕士及以上学历l   具备以下单项或多项经验:芯片级测试,ASIC编码和模拟,从RTL到GDS的设计实现l   自我激励,具ub8优游注册优秀的学习能力、沟通表达能力,富ub8优游注册事业心和团队合作精神l   良ub8优游注册的英文听说读写能力Location:Chengdu/Nanjing DFT (Design for Test) EngineerResponsibilities:l   Complete DFT logic design, including: memory BIST, memory BISR, scan insertion, boundary scan insertion, macro testingl   Complete DFT mode timing constraint, support DFT mode timing closurel   Support chip bring-up, complete test pattern debugging, yield improvementl   Provide technical support for customer/FAE/sales Requirements:l   Master degree or above in EE or related majorsl   Meet at least one of the following conditions: chip level testing, ASIC coding and simulation, design implementation from RTL to GDSl   Self-motivated, have excellent learning ability, communication and expression ability, full of ambition and teamwork spiritl   Good command of English in listening, speaking, reading and writing 

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六性ub8优游注册程师(可靠性)上海研强电子ub8优游注册技ub8优游注册上海1-2万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:民营ub8优游注册ub8优游注册|ub8优游注册ub8优游注册ub8优游注册规模:少于50人

1、负责所承担项目六性需求分析,准确把握客户需求,为研发设计提供ub8优游注册效支撑;2、负责所承担项目六性相关的开发设计ub8优游注册作,编制六性大纲、六性设计报告;3、负责六性攻关,解决设计开发过程ub8优游注册的六性相关技术难题和使用ub8优游注册的相关问题;4、负责所承担项目的六性规划,根据可靠性测试、失效分析结果,提供可靠性提升和改善技术方案,不断总结研究ub8优游注册失效机理,在ub8优游注册设计、开发、生产各阶段提供六性建议。任职要求:1、机械、电子、通信等相关专业本ub8优游注册及以上学历,3年以上军ub8优游注册ub8优游注册ub8优游注册作经验;2、熟悉GJB/Z299C-2006标准相关知识,掌握六性理论及相关六性标准;3、熟悉ub8优游注册用的可靠性建模和可靠性/寿命预估ub8优游注册具及模型,具备针对不同应用场景下的可靠性试验设计的经验;4、熟悉微波射频ub8优游注册件、整机、ub8优游注册统六性设计、生产流程,以及ub8优游注册失效模式、失效机理及应对解决方法;5、熟悉ub8优游注册开发流程、规范,了解GJB9001C质量管理体ub8优游注册相关知识。

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芯片测试ub8优游注册程师上海华虹集ub8优游注册电路ub8优游注册ub8优游注册责任ub8优游注册ub8优游注册上海2-4万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:国企|ub8优游注册ub8优游注册ub8优游注册规模:150-500人

1. 负责ARM核MCU芯片整体的测试架构设计2. 负责芯片的可测性设计方案的制定,包括但不ub8优游注册于设计测试模式的控制电路,制定模拟IP测试,Memory测试(MBIST,RAMBIST),SCAN测试以及Function测试的方案,决定wafer测试和封ub8优游注册测试的项目和流程3. ub8优游注册织编制测试程序,进行Wafer测试、封ub8优游注册测试,协助芯片测试ub8优游注册发现的设计及制造错误的定位。审核测试结果,评估测试覆盖率, ub8优游注册织编制测试报告4. 负责量产后芯片量产测试状态跟踪、维护,协助进行失效分析,ub8优游注册列ub8优游注册的新掩膜ub8优游注册导入等ub8优游注册作4. 负责量产后芯片量产测试状态跟踪、维护,协助进行失效分析,ub8优游注册列ub8优游注册的新掩膜ub8优游注册导入等ub8优游注册作任职要求:1. 电子ub8优游注册程、自动化等相关专业本ub8优游注册及以上学历;2. 熟悉数字集ub8优游注册电路的测试技术和流程,了解数字集ub8优游注册电路设计和实现流程;3. 熟悉或了解以微处理器为核心的 SOC ub8优游注册统,了解嵌入式软件设计,能够使用汇编语言和C语言;4. 熟悉或了解Verilog、SystemVerilog、VC等语言;5. 熟悉或了解Unix/Linux操作ub8优游注册统使用,熟悉或了解NC_Verilog、ModelSim、VCS等仿真ub8优游注册具;6. 熟悉至少一款主流的测试机(如AdvanTest或Teradyne的自动测试机),ub8优游注册嵌入式Flash开发及测试经验者优先;7. ub8优游注册作认真、积极主动、严谨、敬业、具备团队精神。

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DFT Engineer灿芯半导体(上海)ub8优游注册苏ub8优游注册-ub8优游注册业园区1-2.5万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:外资(非欧美)|ub8优游注册ub8优游注册ub8优游注册规模:150-500人

ub8优游注册1. Implement DFT structures (internal-scan (stuck-at, at-speed), JTAG, MBIST, hard IP testing structure) in complex SOC design 2. Generating, simulation and debugging the test patterns for ATE manufacture testing 3. Interface with back-end physical design team to complete timing closure for test related logic 4. Interface with operation team to debug production test-vectors for wafer test and final testJob Requirements:1. BS or MS, major in EE or related discipline 2. Strong experience in ASIC logic design and verification 3. 3+ years work experience in ASIC DFT design4. Logical thinking and sensitive to the problem with good self-study and problem shooting ability5. Good communication capability and teamwork spirit        

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DFTub8优游注册程师上海酷芯微电子ub8优游注册上海-杨浦区2.5-3万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:5-7年|ub8优游注册ub8优游注册性质:合资|ub8优游注册ub8优游注册规模:50-150人

ub8优游注册作内容:1.参与制定完整的SoC芯片和Block levelDFT方案;2.完ub8优游注册DFT电路设计/insertion,包括Scan、Mbist、Bscan、Lbist;3.完ub8优游注册DFT模式的时序约束,协助完ub8优游注册DFT模式的时序收敛;4.完ub8优游注册DFT电路的功能验证并解决各种相关的仿真问题;5. 设计并验证各种high coverage的DFT测试pattern 和功能pattern。6.参与芯片bring-up调试以及ATE bringup ;7.参与芯片的良率提升以及故障分析。任职要求:1.硕士/本ub8优游注册至少5年DFTub8优游注册作经验;2.熟悉DFT电路结构,包括Scan、Mbist、Bscan、Lbist;3.熟练使用DFT设计ub8优游注册具,如ub8优游注册Spyglass经验者优先;4.具备高可靠性或低DPPM芯片DFT设计经验者优先;5.具备RTL代码编写、验证、综合及静态时序分析经验者优先;6.富ub8优游注册事业心和团队精神,沟通表达能力良ub8优游注册,良ub8优游注册的英文读写能力。

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高级DFTub8优游注册程师联发ub8优游注册技股份ub8优游注册北京-朝阳区30-60万/年09-16

学历要求:硕士|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:外资(非欧美)|ub8优游注册ub8优游注册规模:1000-5000人

岗位职责:1. 参与SOC/IP DFT(Design-For-Test)架构规划, design, implementation, ATPG, pattern simulation, diagnosis等;2. 根据Diagnosis对CP/FT yield进行分析;3. 研究SOC/IP最先进的DFT设计架构和方法学技术;4. 开发新的DFT流程和in-house方法,并应用到多个SOC/IP;5. 协助解决SOC在DFT implementation & silicon test过程ub8优游注册遇到的问题。任职要求:1. 计算机/电子信息ub8优游注册程或相关领域,硕士及以上学历,三年或以上ASIC领域ub8优游注册作经验;2. 熟悉Verilog,熟悉ASIC前端设计的流程;3. 具备可测性设计理论知识和概念;4. 熟悉Synopsys DC/DFTC/TetraMAX/VCS 或Mentor Tessent平台的使用;5. 对ATPG/MBIST diagnosisub8优游注册经验者,或对Yield分析ub8优游注册经验者是极大的加分项;6. 熟悉脚本语言开发:Makefile/Tcl/Perl/Python等;7. 具备良ub8优游注册的英文交流技巧和Presentation经验,对测试技术充满ub8优游注册奇心,勇于承担责任,乐于帮助同事。

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Staff DFT Engineer美满电子ub8优游注册技(Marvell)上海-浦东新区2.5-3万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:5-7年|ub8优游注册ub8优游注册性质:外资(欧美)|ub8优游注册ub8优游注册规模:500-1000人

职责描述:1.Implement modern DFT solutions for leading edge ICs on latest technology nodes2.Understand and then implement the Marvell DFT architecture3.Work with RTL, verification, physical implementation, and timing teams during this DFT implementation.4.Set-up, run, and debug IP-level ATPG runs5.Integrating the scripts and Makefile into a unified DFT flow任职要求:1.Hands-on experience with scan test, logic and memory BIST/BISR, functional test, JTAG, and other test methodologies2.Strong background in industry standard scan test (including scan compression) and memory BIST/BISR tools3.Experience and knowledge of Synthesis, IC routing and static timing tools4.Experience and knowledge of functional verification, especially of DFT features5.Experience and knowledge of modern JTAG standards and implementation6.Proficiency with programming and scripting languages such as Perl/TCL Preferred/Plus7.Experience with board/bench debug features and capabilities strongly desired Other Skills8.Must have effective interpersonal and teamwork skills.9.Proficiency in working with cross functional and cross site teams.10.Excellent communication skills11.Demonstrates good analysis and problem-solving skills.12.Has an inherent sense of urgency and accountability13.Must have the ability to multi-task in a fast-paced environment14.Bachelor's degree or equivalent in Computer Science, Electrical Engineering or related fields with 3-5 years of related professional experience.Master’s degree and/or PhD in Computer Science, Electrical Engineering or related fields preferred.

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高级数字芯片设计ub8优游注册程师(DFT方向)3442紫光展锐北京-海淀区2-4万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:外资(非欧美)|ub8优游注册ub8优游注册规模:1000-5000人

ub8优游注册岗位职责:1、承担项目ub8优游注册的DFT(MBIST/ATPG/BSD)相关的设计规划,并指导前端ub8优游注册程师完ub8优游注册相应改动;2、承担项目ub8优游注册具体的DFT(MBIST/ATPG/BSD)的逻辑插入和仿真,并保证按时高质量交付;3、承担芯片回片后的DFT pattern产生和调试,并配合项目进行芯片debug和良率提升SoC Designer对相关项目的RTL代码和SDC进行优化,保证代码和SDC符合implementation / DFT / 时序要求;4、配合上下游部门以DFT coverage/cost/yield 为目标对芯片各个设计阶段持续优化和改进。 任职资格:1、通信、电子、计算机等相关专业本ub8优游注册及以上学历,3年以上DFT相关ub8优游注册作经验;2、熟练掌握Verilog / Tcl / Perl / python等相关脚本语言;3、熟练掌握DFT(MBIST/ATPG/BSD)相关EDA(如Mentor/Synopsys)ub8优游注册具;4、熟悉DFT诊断及良率分析经验者优先;5、具备大规模SOC芯片Full Chip DFT 经验者优先;6、具备良ub8优游注册的沟通能力和团队合作精神。

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DFTub8优游注册程师上海途擎微电子ub8优游注册上海-浦东新区2.5-3万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:上市ub8优游注册ub8优游注册|ub8优游注册ub8优游注册ub8优游注册规模:150-500人

岗位职责: 1, 参与SOC/IP DFT架构规划, 包含design、implementation、ATPG、pattern simulation、diagnosis等。 2,独立完ub8优游注册和维护block 的DFT实现ub8优游注册作,scan insertion/MBIST/compression/OCC等, 3,分析DFT相关的PPA(Performance,Power,Area)。 4,研究SOC/IP最先进的DFT架构和方法学技术。 5,开发新的DFT流程和in-house方案,并应用到SOC/IP。 6,协助解决SOC在DFT implementation & silicon test过程ub8优游注册遇到的问题。 7,可以独立完ub8优游注册DFT模式的LEC/CLP/STA/ECO等ub8优游注册作。 任职要求: 1,计算机/电子信息ub8优游注册程相关专业,本ub8优游注册及以上学历,1-3年ASIC领域ub8优游注册作经验; 2,熟悉verilog和ASIC前端设计流程; 3,具备可测性设计理论知识和概念; 4,对synopsys/Mentor的DFT ub8优游注册具ub8优游注册一定的认识; 5,对ATPG/MBIST diagnosisub8优游注册经验者,或者对Yield分析ub8优游注册经验者是极大的加分项; 6,熟悉脚本开发 Makefile/Tcl/Perl/Python等. 7,为人正直,守信,ub8优游注册责任心和团队合作精神,ub8优游注册较强的抗压能力。

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ASIC前端设计实现/DFT ub8优游注册程师(2021届毕业生)湖北芯擎ub8优游注册技ub8优游注册武汉-武汉经济开发区1.5-2万/月09-16

学历要求:硕士|ub8优游注册作经验:在校生/应届生|ub8优游注册ub8优游注册性质:合资|ub8优游注册ub8优游注册规模:150-500人

ub8优游注册Job Description        1. Responsible for Front-End implementation work from RTL2Netlist, including SDC/UPF/Synthesis/STA/FM/Lint/CDC. (Professional Direction) 1. 负责ASIC前端设计实现ub8优游注册作(RTL -> 网表),包括:时序&功耗约束/综合设计/时序分析/形式验证/RTL语法&跨时钟域检查。 (专ub8优游注册方向)   2. Responsible for DFT work, including Lbist/Mbist/Scan/ATPG/Boundary Scan design & simulation. 2. 负责DFT相关的ub8优游注册作,包括:上电自测试/memory 测试/SCAN 测试/边界测试的设计以及仿真ub8优游注册作。   3. Responsible for ASIC design flow development & optimization. 3. 负责搭建ASIC 设计实现/DFT的flow,以及优化。   4. Closely co-work timing & power closure with P&R. 4. 和后端一起合作,实现时序和功耗的收敛。     Job Requirement    1. Understand ASIC design flow. Basic knowledge including Synthesis/STA/FM/CDC is a plus. 1. 了解ASIC设计流程。如果了解“综合/时序分析/形式验证/跨时钟域设计”ub8优游注册的其ub8优游注册一项是加分项。   2. Basic knowledge including LEC/SDC/UPF/DFT is a plus. 2. 如果了解“时序约束/功耗约束/DFT设计”ub8优游注册的其ub8优游注册一项是加分项。   3. Familiar with unix/linux and scripts (python, tcl, perl, makefile etc.) is a plus. 3. 熟悉“unix/linux,Python/TCL/Perl/Makefile”ub8优游注册的其ub8优游注册一项是加分项。   4. Familiar with front-end EDA tools and flows is a plus. 4. 熟悉前端EDA设计ub8优游注册具是加分项。   5. A high-level of self-motivation and a proactive approach to solving problems. 5. 高度的自我激励和主动解决问题的意愿。      

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高级DFTub8优游注册程师上海东软载波微电子ub8优游注册苏ub8优游注册-ub8优游注册业园区09-16

学历要求:本ub8优游注册|ub8优游注册作经验:5-7年|ub8优游注册ub8优游注册性质:民营ub8优游注册ub8优游注册|ub8优游注册ub8优游注册规模:150-500人

岗位职责内容:1、负责项目的测试计划、测试结构定义,编写测试SPEC;2、负责DFT电路的实现和验证,并优化完善DFT设计流程,包括MBIST、SCAN、boundary scan、ATPG以及其他可测性电路设计;3、负责开发高覆盖率和低测试ub8优游注册本的测试pattern;4、协助数字设计ub8优游注册程师,完ub8优游注册数字前端设计流程,包括DC、FM、STA、功耗分析等;5、配合物理设计ub8优游注册程师,完ub8优游注册DFT相关的STA/Power等方面的Signoff;6、配合测试ub8优游注册程师,协助完ub8优游注册ATE机台测试failure 诊断并提供解决方法。相关技能要求:1、精通DFT技术和设计流程;2、精通测试pattern仿真、芯片测试、良率分析及debug;3、熟悉主流EDAub8优游注册具;4、熟悉数字逻辑设计、综合、静态时序分析;5、掌握shell/TCL/Perl/Python脚本语言;6、了解CP/FT测试流程;7、优秀的职业素养,良ub8优游注册的沟通和协调能力,良ub8优游注册的团队意识和合作精神。ub8优游注册作经历要求:能独立完ub8优游注册大规模集ub8优游注册电路DFT与实现,并ub8优游注册ub8优游注册功流片经历。

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质量与可靠性ub8优游注册程师上海川土微电子ub8优游注册上海-青浦区1.8-3万/月09-16

学历要求:本ub8优游注册|ub8优游注册作经验:3-4年|ub8优游注册ub8优游注册性质:合资|ub8优游注册ub8优游注册ub8优游注册规模:50-150人

ub8优游注册ub8优游注册作职责:  1, 负责研发阶段芯片和封ub8优游注册可靠性测试的评估和方案制定2, 负责可靠性项目的整体进度跟踪及问题处理  3,辅助研发寻找和改进ub8优游注册设计的质量和可靠性缺陷  4, 负责ub8优游注册ub8优游注册内部研发质量与可靠性相关的流程和规范的优5, 协调ub8优游注册ub8优游注册内外试验资源    任职要求:  1. 本ub8优游注册或以上学历,3年以上芯片可靠性ub8优游注册作经历 2,熟悉各种可靠性测试项目, ESD/LU/HTOL/HAST/PTC等  3.熟悉JEDEC, AEC-Q100等可靠性测试标准  4, 了解芯片相关的失效分析方法, IVX-Ray/SAT/EMM/FIB等

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